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星期四, 1月 04, 2007. Reg Bin,clk,reset;. Wire q0,q0 bar,q1,q1 bar,q11,q10,D1,bin bar,b1,b2,b3,b4,Bout;. DFF m3(clk,q0 bar,reset,q0,q0 bar);. DFF m7(clk,D1,reset,q1,q1 bar);. Nand #3 m1(bin bar,Bin,Bin);. Nand #3 m4(q11,q0 bar,q1);. Nand #3 m5(q10,q0,q1 bar);. Nand #3 m6(D1,q11,q10);. Nand #3 m8(b1,q0 bar,q1,bin bar);. Nand #3 m9(b2,q1 bar,q0,bin bar);. Nand #3 m10(b3,q0,q1,Bin);. Nand #3 m11(b4,q0 bar,q1 bar,Bin);. Nand #3 m12(Bout,b1,b2,b3,b4);. Clk=0;Bin=1;reset=0;. 28 clk= clk;. Input clk,D,reset;.

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4 0104使用synapiticad與silos執行上星期的第三階段測試
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uoyroflla: 1226 第三階段測試

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星期二, 11月 21, 2006. 星期一, 11月 20, 2006. 下圖為(A,B,C,D)=(0110). 訂閱: 文章 (Atom).

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uoyroflla: 1228第三階段考試

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uoyroflla: 0104使用synapitiCAD與silos執行上星期的第三階段測試

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uoyroflla: 十二月 2006

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星期四, 12月 28, 2006. 星期二, 12月 26, 2006. 星期二, 12月 12, 2006. Wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;. Nand q1(a1,a,a);. Nand q2(b1,b,b);. Nand q3(c1,c,c);. Nand q4(d1,d,d);. Nand q7(f1,a,b1,c);. Nand q8(f2,a,c,d1);. Nand q9(f3,a1,c1);. Nand q10(f4,a1,b,c,d);. Nand q6(f5,f4,f1,f2,f3);. Nand q5(F,f5,f5,f5,f5);. A=0;b=0;c=0;d=0;. 200 a= a;. 100 b= b;. Wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;. Nand #3 q1(a1,a,a);. Nand #3 q2(b1,b,b);. Nand #3 q3(c1,c,c);. Nand #3 q4(d1,d,d);. Nand #3 q7(f1,a,b1,c);. Nand #3 q8(f2,a,c,d1);.

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研究記錄簿: Implenebtation of an encoder for turbo codes using the MIPS-like architecture

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Implenebtation of an encoder for turbo codes using the MIPS-like architecture. 訊號在傳送之前,必須經過編碼後再傳送出去.當有訊號要傳送時,輸出端可分為三個部份,一個為將原始訊號輸出;一個為將訊號經過encoder後在輸出;另一個為將訊號經過交錯器後,在進行編碼. 首先使用C語言撰寫turbo code的encoder驗證正確後,使用LCC將C語言的encoder程式編譯為MIPS組合語言程式,接著修改部分組合語言內容後,使用PCSpim驗證經由LCC編譯的MIPS組合語言程式是否正確,驗證正確後再將PCSpim所產生的rom與sram擷取出來,放置在使用Verilog HDL撰寫的似MIPS架構上,最後在使用xilinx ise配合modelsim驗證與模擬. 訂閱: 張貼留言 (Atom). Online Viterbi Decoding Tool (University of New Brunswick). Implenebtation of an encoder for turbo codes using.

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研究記錄簿: 五月 2008

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使用C語言實現通訊系統架構,加入本研究撰寫的convolutional Encoder 跟 Viterbi decoder執行過後,將資料放在Matlab上執行,執行結果如下圖:. 訂閱: 文章 (Atom). Online Viterbi Decoding Tool (University of New Brunswick).

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F9203843: 十月 2006

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星期二, 10月 24, 2006. Wire a,b;. System clock #100 clock1(a);. System clock #50 clock2(b);. Module system clock(clk);. Begin#(PERIOD/2) clk= clk;. PERIOD-PERIOD/2) clk= clk;. Endalways @ (posedge clk). Posted by f9203843 @ 2:44 下午. 星期二, 10月 17, 2006. Posted by f9203843 @ 10:02 下午. 星期二, 10月 03, 2006. Posted by f9203843 @ 8:43 下午. Posted by f9203843 @ 1:32 上午. 星期一, 10月 02, 2006. Posted by f9203843 @ 4:32 下午. 21729;林鎮, 大葉大學, Taiwan. 31532;三階段. 31532;二階段. 26032;學期. 31532;三階段考試.

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蔚藍海域: 十二月 2006

http://bluerain1101.blogspot.com/2006_12_01_archive.html

星期四, 12月 07, 2006. 針對某 4 inputs, 1 outpout 電路進行真值表、K-Map化簡。 並找出 0-Hazard 所在,進行改進設計使其成為 0-Hazard Free。 所有數位電路設計均以結構化 Verilog 設計(僅使用 NAND 邏輯閘)。 2 求出輸出布林函數後,以 Verilog HDL 來設計此電路,程式碼如下. Verilog 1205(A,B,C,D,F);. A1,b1,c1,d1,f1,f2,f3,f4,f5;. 5 (a1,A,A);. 5 (b1,B,B);. 5 (c1,C,C);. 5 (d1,D,D);. 5 (f1,a1,b1,d1);. 5 (f2,B,c1);. 5 (f3,A,B,D);. 5 (f4,A,b1,c1);. 5 (f5,f1,f2,f3,f4);. 5 (F,f5,f5);. Verilog 1205 V0 (A,B,C,D,F);. 0 A=0; B=0; C=0; D=0;. A=0; B=0; C=0; D=0;. 320 A= A;. 160 B= B;. A:0 B:0 1 C:0 D:0.

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計算機設計: 3/19 第一階段測試結果

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蔚藍海域: 十一月 2006

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星期三, 11月 29, 2006. 針對某 4 inputs、1 outpout 電路進行真值表、K-Map化簡。 0-Hazard 所在,然後進行改進設計使其成為 0-Hazard Free。 以 MAX plus II 模擬驗證. 為了找出 0-Hazard 所在,在 這裡不將卡諾圖化到最簡). 2 在 MAX plus II 上畫出電路圖,如下圖。 A:0 B:0 1 C:0 D:0. A:0 B:0 1 C:1 D:1. A:0 B:1 C:1 D:0 1. 4 下圖為 0-Hazard 的模擬波形圖。 A:0 B:0 1 C:0 D:0 的情形. A:0 B:0 1 C:1 D:1 的情形. A:0 B:1 C:1 D:0 1 的情形. 5 在卡諾圖中進行修改設計,將 0-Hazard 消除掉。 6 下圖為 0-Hazard Free 的電路圖及模擬波形圖,由波形圖中可看到 0-Hazard 已被消除。 A:0 B:0 1 C:0 D:0 的情形. A:0 B:0 1 C:1 D:1 的情形. A:0 B:1 C:1 D:0 1 的情形. Posted by 笨笨魚 @ 4:58 下午.

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怎麼會這樣: 十二月 2006

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星期二, 12月 26, 2006. Wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;. Nand q1(a1,a,a);. Nand q2(b1,b,b);. Nand q3(c1,c,c);. Nand q4(d1,d,d);. Nand q5(f1,a1,c1);. Nand q6(f2,a1,b,d);. Nand q7(f3,a,c,d1);. Nand q8(f4,a,b1,c);. Nand q9(f5,f1,f2,f3,f4);. Nand q10(F,f5,f5,f5,f5);. A=0;b=0;c=0;d=0;. 200 a= a;. 100 b= b;. Wire a1,b1,c1,d1,f1,f2,f3,f4,f5,F;. Nand #3 q1(a1,a,a);. Nand #3 q2(b1,b,b);. Nand #3 q3(c1,c,c);. Nand #3 q4(d1,d,d);. Nand #3 q5(f1,a1,c1);. Nand #3 q6(f2,a1,b,c,d);/ 去除Hazard. Nand #3 q6(f2,a1,b,d);.

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星期二, 11月 21, 2006. Posted by 阿弟的天空 @ 9:53 下午. 星期三, 11月 15, 2006. 針對某4 inputs, 1 outpout 電路, 進行真值表, K-Map, 化簡. F=(B' C D')(A' C D')(A B C')(A C' D)(B C' D)(A B D)(A' B' C D'). F=(B' C D')(A' C D')(A B C')(A C' D)(B C' D)(A B D)(A' B' D'). Posted by 阿弟的天空 @ 12:42 上午. 38463;弟的天空. 31532;二階段練習. 32066;於發現Hazard. 31532;一階段. 21407;來是這樣. 20316;業一. 20170;天的課外活動! 20358;灌灌水ㄅ.把我淹沒.

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